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Efficient realisation of MOS-NDR threshold logic gates

Núñez, J. ; Avedillo, M. J.; Quintana, J. M.

Tipo: Artículo
Año de Publicación: 2009
Volumen: 45
Número: 23
Páginas: 1158 - 1159
Fuente Nº Citas Fecha Actualización
scopus1629-10-2024
wos1229-10-2024
Dimensions
PlumX
Altmetric

Año: 2009

Journal Impact Factor (JIF): 0.970

CategoríaEdiciónPosiciónCuartilTercilDecil
ENGINEERING, ELECTRICAL & ELECTRONICSCIE124/246Q3T2D6

Año: 2017

Journal Citation Indicator (JCI): 0,480

CategoríaPosiciónCuartilTercilDecilPercentil
ENGINEERING, ELECTRICAL & ELECTRONIC177/306Q3T2D642,32

Año:

2011

CiteScore:

2,500

CategoríaPosiciónCuartilTercilDecil
Electrical and Electronic Engineering162/589Q2T1D3

SJR año:

2009

Factor de Impacto:

0,665

CategoríaPosiciónCuartilTercilDecil
Electrical and Electronic Engineering130/598Q1T1D3
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Agencia Código de Proyecto
Junta de AndaluciaTIC-2961
Spanish GovernmentTEC2007-67245/MIC
Nota: los datos sobre financiación provienen de la WOS
# Autor Afiliación
1Núñez, J. Universidad de Sevilla (Spain)
2Avedillo, M. J.Universidad de Sevilla (Spain)
3Quintana, J. M.Universidad de Sevilla (Spain)