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Design and characterisation of a CMOS VLSI self-timed multiplier architecture based on a bit-level pipelined-array structure

Acosta, AJ ; Jimenez, R; Barriga, A; Bellido, MJ; Valencia, M; Huertas, JL

Tipo: Artículo
Año de Publicación: 1998
Volumen: 145
Número: 4
Páginas: 247 - 253
Fuente Nº Citas Fecha Actualización
scopus729-10-2024
wos729-10-2024
Dimensions
PlumX
Altmetric

Año: 1998

Journal Impact Factor (JIF): 0.2670

CategoríaEdiciónPosiciónCuartilTercilDecil
ENGINEERING, ELECTRICAL & ELECTRONICSCIE134/208Q3T2D7
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# Autor Afiliación
1Acosta, AJ Centro Informático Cientifico de Andalucia (Spain)
2Jimenez, RSin datos ()
3Barriga, ASin datos ()
4Bellido, MJSin datos ()
5Valencia, MSin datos ()
6Huertas, JLSin datos ()